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多选题
在以下关于布局布线算法的描述中，哪些是正确的（）。
A
是一种高速计算近似值的算法
B
是在实际可行的时间内计算布局布线最优解的算法
C
是求局部最优解的算法
D
为了让近似值接近最优解，有必要改变执行条件（初解、控制参数）多次进行重新计算
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考题
以下关于综合布线与传统布线的描述中，哪个是错误的?——A．综合布线比传统布线具有经济性优点，主要是综合布线可适应相当长时间需求B．综合布线采用光纤与双绞线混合布线方式，极为合理地构成一套完整的布线C．综合布线取代单一、昂贵、复杂的传统布线，是“信息时代”的要求D．相比传统布线，综合布线在设计、施工方面要复杂、困难许多
考题
下面关于算法的叙述中，正确的是（ ）。A)算法的执行效率与数据的存储结构无关B)算法的有穷性是指算法必须能在执行有限个步骤之后终止C)算法的空间复杂度是指算法程序中指令(或语句)的条数D)以上三种描述都正确
考题
下面关于综合布线和传统布线的描述中，不正确的( )。A)综合布线比传统布线的优点是经济性，主要是综合布线可适应相当长时间的需求B)相比传统布线，综合布线在设计、施工方面复杂困难很多C)综合布线取代单一昂贵、复杂的传统布线，是“信息时代”的要求D)综合布线，采用光纤与双绞线混合布线方式，极为合理地构成一套完整的布线
考题
以下关于算法的叙述中错误的是A)算法可以用伪代码、流程图等多种形式来描述B) 一个正确的算法必须有输入C) 一个正确的算法必须有输出D)用流程图描述的算法可以用任何一种计算机高级语言编写成程序代码
考题
以下关于算法与数据结构关系的描述中，说法正确的是(57)。A．算法的实现依赖于数据结构的设计B．算法的效率与数据结构无关C．数据结构越复杂，算法的效率越高D．数据结构越简单，算法的效率越高
考题
下列选项中，关于综合布线和传统布线的描述不正确的是( )。A．相比传统布线，综合布线在设计、施工方面要复杂困难许多B．综合布线取代单一、昂贵、复杂的传统布线，是“信息时代”的要求C．综合布线比传统布线具有经济性优点，主要是综合布线可适应相当长时间需求D．综合布线，采用光纤与双绞线混合布线方式，极为合理地构成一套完整的布线。
考题
对布线问题，以下（）是不正确描述。A、布线问题的解空间是一个图B、可以对方格阵列四周设置围墙，即增设标记的附加方格的预处理，使得算法简化对边界的判定C、采用广度优先的标号法找到从起点到终点的布线方案（这个方案如果存在的话）不一定是最短的D、采用先入先出的队列作为活结点表，以终点b为扩展结点或活结点队列为空作为算法结束条件
考题
关于在布局中创建的尺寸，以下说法正确的是？（）A、在布局中标注的关联尺寸会随视口比例的变化而缩放B、在布局中标注的非关联尺寸会随视口比例的变化而缩放C、在布局中创建的标注可以随时更改它的关联特性为“是”或“否”D、在布局中不能创建非关联尺寸
考题
单选题以下关于综合布线与传统布线的描述中，哪个是错误的？（ ）A
综合布线比传统布线具有经济性优点，主要是综合布线可适应相当长的时间需求B
综合布线采用光纤与双绞线混合布线方式，极为合理地构成一套完整的布线C
综合布线取代单一、昂贵、复杂的传统布线，是“信息时代”的要求D
相比传统布线，综合布线在设计、施工方面要复杂、困难许多
考题
多选题以下关于设计抽象度的描述中，哪些是正确的（）。A算法级描述决定系统的实施方式（体系结构、算法）B门级描述是基于基本元件（AND/OR/NOT/FF等）的电路设计C门级描述决定硬件的处理方式（数据电路与控制电路）DRTL描述包括时钟级的时序设计
考题
单选题以下关于算法的叙述中错误的是（ ）。A
算法可以用伪代码、流程图等多种形式来描述B
一个正确的算法必须有输入C
一个正确的算法必须有输出D
用流程图可以描述的算法可以用任何一种计算机高级语言编写成程序代码
考题
单选题算法是问题求解规则的一种过程描述，下列关于算法性质的叙述中，正确的是（）A
算法要求在若干或无限步骤内得到所求问题的解答B
算法一定要用高级语言描述C
条件选择结构有条件和选择两种操作组成，因此算法中允许有二义性。D
可采用类似自然语言为“伪代码”或流程图来描述算法
考题
单选题关于在布局中创建的尺寸，以下说法正确的是？（）A
在布局中标注的关联尺寸会随视口比例的变化而缩放B
在布局中标注的非关联尺寸会随视口比例的变化而缩放C
在布局中创建的标注可以随时更改它的关联特性为“是”或“否”D
在布局中不能创建非关联尺寸
考题
多选题在以下关于布局布线的描述中，哪些是正确的（）。A布线分全局布线与详细布线两个阶段，决定布线途径B当某个布线变为不可能时，确定并拆除成为其障碍物的布线群，进行重新布线，使其不再成为其它布线的障碍C基于阶层的布局设计包括自顶向下的布图规划和自下向上的模块布局D自顶向下的布图规划包括对阶层模块进行面积预估、确定aspect比、放置模块及模块间时间制约的分割
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