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实现一个十进制的可逆计数器,至少需要()个触发器。

  • A、3
  • B、4
  • C、5
  • D、6

参考答案

更多 “实现一个十进制的可逆计数器,至少需要()个触发器。A、3B、4C、5D、6” 相关考题
考题 设计一个十进制计数器,需要的触发器个数至少为()。 A.2个B.4个C.6个D.10

考题 构成一个7进制计数器需要3个触发器。()

考题 若希望采用触发器设计一个六进制同步计数器,故需要()个触发器。 A、3B、2C、6D、4

考题 要构成5进制计数器,至少需要()个触发器。 A、0B、1C、2D、3

考题 一位8421BCD计数器,至少需要()个触发器A、3B、4C、5D、10

考题 一位8421BCD码计数器至少需要()个触发器。A、3B、4C、5D、10

考题 设计一个8421码加1计数器,至少需要()触发器 A.3B.4C.6D.10

考题 构成一个7进制计数器需要三个触发器。() 此题为判断题(对,错)。

考题 欲构成能记最大十进制数为999的计数器,至少需要多少个双稳态触发器?( )A.10 B.100 C.1000

考题 一个模100的计数器至少需要()个触发器。A、6B、7C、8D、10

考题 集成计数器74LS192是()计数器。A、异步十进制加法B、同步十进制加法C、异步十进制减法D、同步十进制可逆

考题 一个由触发器组成的计数器,要求能记录100个计数脉冲,至少需要()个触发器。A、5B、7C、8

考题 异步计数器的特点是()A、异步计数器中的触发器没有一个共同的时钟脉冲B、异步计数器不需要时钟脉冲C、异步计数器的触发器共用一个时钟脉D、异步计数器只能做减法计数器

考题 用触发器设计一个同步十七进制计数器所需要的触发器数目是()。A、2B、3C、4D、5

考题 集成计数器40192是一个可预置数二-十进制可逆计数器。

考题 如果计数器的计数脉冲不是同时加到所有触发器的计数输入端,而只加到最低位触发器的计数输入端,其他各级触发器则由相邻的低位触发器来触发,这时计数器称为()。A、同步计数器;B、异步计数器;C、可逆计数器;D、步计数器。

考题 若要把一个频率为10KHz的矩形波变换成为一个1KHz的矩形波,应采用()。A、十进制计数器B、单稳态触发器C、施密特触发器D、石英晶体多谐振荡器

考题 74LS160十进制计数器它含有的触发器的个数是()A、1个B、2个C、4个D、6个

考题 设计一个8421码加1计数器,至少需要()触发器。A、3个B、4个C、6个D、10个

考题 一位十进制计数器至少需要()个触发器。A、3B、4C、5D、10

考题 构造一个模10同步计数器,需要()触发器。A、3个B、4个C、5个D、10个

考题 设计一个模65的同步计数器,至少需要()个触发器。

考题 构造一个十进制的异步加法计数器,需要多少个()触发器。计数器的进位Cy的频率与计数器时钟脉冲CP的频率之间的关系是()。

考题 一个十进制计数器至少需要()个触发器。A、3B、4C、5D、10

考题 计数器可用触发器构成,()JK触发器可以构成一个十进制计数器。A、2个B、4个C、5个D、10个

考题 单选题一位8421BCD码计数器至少需要()个触发器。A 3B 4C 5D 10

考题 单选题若要把一个频率为10KHz的矩形波变换成为一个1KHz的矩形波,应采用()。A 十进制计数器B 单稳态触发器C 施密特触发器D 石英晶体多谐振荡器