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计数器可用触发器构成，（）JK触发器可以构成一个十进制计数器。

  • A、2个
  • B、4个
  • C、5个
  • D、10个

参考答案

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考题 构成一个7进制计数器需要3个触发器。()
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考题 单稳态触发器可作()A、产生正弦波B、延时C、构成D触发器D、构成JK触发器
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考题 构成同步二进制计数器一般应选用的触发器是A、D触发器B、R-S触发器C、J-K触发器D、T触发器
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考题 构成计数器的基本单元是()。 A.与非门B.或非门C.触发器
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考题 构成一个7进制计数器需要三个触发器。() 此题为判断题(对，错)。
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考题 计数器的模是指构成计数器的触发器的个数。() 此题为判断题(对，错)。
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考题 构成计数器的基本电路是()。 A、与门B、或门C、非门D、触发器
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考题 选出下列电路中哪些可以用来构成计数器()。 A、全加器B、与非门C、JK触发器D、SRAM;
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考题 试用上升沿JK触发器构成同步3位二进制加法计数器,要求画出逻辑电路图。
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考题 试用D触发器构成3位格雷码计数器。
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考题 用JK触发器搭12进制计数器，最少需要( )个JK触发器。A、12 B、6 C、4 D、3
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考题 欲构成能记最大十进制数为999的计数器，至少需要多少个双稳态触发器？( )A.10 B.100 C.1000
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考题 同步计数器是指（）的计数器。A.由同类型的触发器构成 B.各触发器时钟端连在一起，统一由系统时钟控制 C.可用前级的输出做后级触发器的时钟 D.可用后级的输出做前级触发器的时钟
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考题 由8个JK触发器构成的二进制计数器，其计数范围是（）。 A.1~8 B.1~256 C.0—255 D.0—256
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考题 触发器是构成计数器的基本单元
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考题 异步计数器的特点是（）A、异步计数器中的触发器没有一个共同的时钟脉冲B、异步计数器不需要时钟脉冲C、异步计数器的触发器共用一个时钟脉D、异步计数器只能做减法计数器
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考题 触发器的一个重要作用是构成各种形式的计数器，用于记忆输入脉冲的幅度。
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考题 同步计数器是指（）的计数器。 A、由同类型的触发器构成B、各触发器时钟端连在一起，统一由系统时钟控制C、可用前级的输出做后级触发器的时钟D、可用后极的输出做前级触发器的时钟
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考题 如果计数器的计数脉冲不是同时加到所有触发器的计数输入端，而只加到最低位触发器的计数输入端，其他各级触发器则由相邻的低位触发器来触发，这时计数器称为（）。A、同步计数器；B、异步计数器；C、可逆计数器；D、步计数器。
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考题 构成计数器的基本单元是（）。A、与非门B、或非门C、触发器
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考题 组合逻辑电路是由（）构成。A、门电路B、触发器C、门电路和触发器D、计数器
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考题 组合逻辑电路通常由（）构成。A、门电路B、触发器C、计数器D、寄存器
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考题 计数器的模是指构成计数器的触发器的个数。
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考题 构造一个十进制的异步加法计数器，需要多少个（）触发器。计数器的进位Cy的频率与计数器时钟脉冲CP的频率之间的关系是（）。
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考题 一个十进制计数器至少需要（）个触发器。A、3B、4C、5D、10
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考题 异步二进制计数器基本计数单元是（）。A、T触发器B、计数触发器C、JK触发器D、D触发器E、RS触发器
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考题 填空题构成一个六进制计数器最少要采用（）位触发器，这时构成的电路有6个有效状态，2个无效状态。
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