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利用异步清零端构成M 进制加法计数器，则译码状态应为（）。

A．M

B．M+1

C．M-1

D．N-1

参考答案和解析
M
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考题 图所示逻辑电路，设触发器的初始状态均为0，当 时，该电路实现的逻辑功能是（　　）。 A．同步十进制加法计数器 B．同步八进制加法计数器 C．同步六进制加法计数器 D．同步三进制加法计数器
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考题 按计数器状态变化的规律分类，计数器可分为什么类型的计数器？( )A.加法、减法及加减可逆 B.同步和异步 C.二、十和M进制
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考题 用同步状态译码预置数法构成M进制加法计数器，若预置数据为0，则应将什么所对应的状态译码后驱动预置数控制端？( )A.M B.M-l C.M+l
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考题 图示的74LS161集成计数器构成的计数器电路和74LS290集成计数器构成的计数器电路是实现的逻辑功能依次是（　　）。 A． 九进制加法计数器，七进制加法计数器 B． 六进制加法计数器，十进制加法计数器 C． 九进制加法计数器，六进制加法计数器 D． 八进制加法计数器，七进制加法计数器
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考题 如图所示异步时序电路，该电路的逻辑功能为（　　）。 A． 八进制加法计数器 B． 八进制减法计数器 C． 五进制加法计数器 D． 五进制减法计数器
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考题 集成计数器40192具有（）功能。A、异步清零B、并行置数C、加法计数D、减法计数E、同步清零
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考题 时序逻辑电路的计数器直接取相应进制数经相应门电路送到（）端。A、异步清零端B、同步清零端C、异步置数端D、同步置数端
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考题 集成计数器74LS192是（）计数器。A、异步十进制加法B、同步十进制加法C、异步十进制减法D、同步十进制可逆
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考题 四位异步二进制减法计数器，先清零，2个脉冲后输出状态为（）A、1110B、0010C、1011D、0001
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考题 一异步三位二进制加法计数器，当第8个CP脉冲过后，计数器状态变为（）。A、000B、010C、110D、101
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考题 时序逻辑电路的计数器取相应进制数少一经相应门电路送到（）端。A、异步清零端B、同步清零端C、异步置数端D、同步置数端
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考题 集成二--十进制计数器74LS90是（）计数器。A、异步二--五--十进制加法B、同步十进制加法C、异步十进制减法D、同步十进制可逆
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考题 集成计数器74LS161是（）计数器。A、二进制同步可预置B、二进制异步可预置C、二进制同步可清零D、二进制异步可清零
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考题 利用反馈归零法获得N进制计数器时，若为异步置零方式，则状态SN只是短暂的过渡状态，不能稳定而是立刻变为0状态。
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考题 一个异步三位二进制异步加法计数器，当第4个CP脉冲过后，计数器的状态变为（）A、000B、010C、100D、101
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考题 一异步三位二进制加法计数器，当第8个CP脉冲后，计数器状态为（）。A、000B、010C、110D、101
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考题 集成计数器40192具有（）功能。A、异步清零B、并行置数C、加法计数D、减法计数E、脉冲输出
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考题 按计数器状态变化的规律分类，计数器可分为（）计数器。A、加法、减法和可逆B、同步和异步C、二、十和N进制D、一位和N位
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