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在计数译码显示实验中，74LS161计数器输出（QD-QA）连接到4511译码器输入端（D-A)的连线应为 。

A．QD-D，QC-C，QB-B，QA-A

B．QD-A，QC-C，QB-B，QA-D

C．QD-D，QA-C，QB-B，QC-A

D．QD-A，QA-C，QB-B，QC-D

参考答案和解析
QD-D ， QC-C ， QB-B ， QA-A
更多 “在计数译码显示实验中，74LS161计数器输出（QD-QA）连接到4511译码器输入端（D-A)的连线应为 。A．QD-D，QC-C，QB-B，QA-AB．QD-A，QC-C，QB-B，QA-DC．QD-D，QA-C，QB-B，QC-AD．QD-A，QA-C，QB-B，QC-D” 相关考题
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考题 译码器哪个输出信号有效取决于译码器的地址输入信号。()
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考题 下列器件中，属于时序部件的是()。A、计数器B、译码器C、加法器D、多路选择器
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考题 下列哪些是译码器74138的特点?( )A、有三个输入端B、有四个输入端C、有八个输出端D、有十六个输出端
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考题 下列有关译码器的说法哪些是不正确的?() A、译码器不一定是一个最小项发生器B、3-8译码器是一个最小项发生器C、译码器可以作为数据分配器使用D、在负逻辑约定中，译码器输出端低有效表示输出0有效
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考题 七段显示译码器,当译码器七个输出端状态为abcdefg=0011111时(高电平有效),译码器输入状态(8421BCD码)应为( )。 A.0011;B.0110;C.0101;D.0100
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考题 控制器主要由______、译码器、程序计数器、操作控制器等组成。
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考题 锁存器接在计数器与译码器之间，仅当控制逻辑发出选通信号时，计数器中的A／D转换结果才能送至译码器。A对B错
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考题 测量仪表中数字显示电路由（）部分组成。A、计数器B、译码器C、驱动器D、显示器
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考题 译码器、计数器、全加器和寄存器都是组合逻辑电路。
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考题 锁存器接在计数器与译码器之间，仅当控制逻辑发出选通信号时，计数器中的A／D转换结果才能送至译码器。
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考题 下列逻辑电路中不是时序逻辑电路的有（）A、译码器B、加计数器C、减计数器D、寄存器
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考题 地址译码器的输入端应接到（）上。A、控制总线B、数据总线C、地址总线D、外部总线
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考题 地址译码器的输入端应接到（）。A、控制总线B、数据总线C、地址总线D、外部总线
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考题 当单片机所有多余的地址线都接到译码器的信号输入端时，这种译码方式称为（）。A、线译码B、部分译码C、全译码D、混合译码
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考题 二进制译码器和二-十进制译码器，对应于一个输入代码，只有唯一一个输出端输出有效电平。
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考题 N个输入端的二进制译码器，共有（）个输出端。对于每一组输入代码，有（）个输出端是有效电平。
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考题 能实现从多个输入端中选出一路作为输出的电路称为（）。A、触发器B、计数器C、数据选择器D、译码器
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考题 3—8译码器74LS138在全译码寻址方式中，译码器的输出端通常与单片机接口芯片的（）端连接。
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考题 集成译码器无法工作，首先应检查（）的状态。A、输入端B、输出端C、清零端D、使能端
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考题 微电子交流计数自动闭塞中译码器的作用是（）交流计数器。
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考题 集成二--十进制计数器可通过显示译码器将计数结果显示出来。
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考题 译码器、计数器、全加器和寄存器都是逻辑组合电路。
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考题 集成译码器的（）状态不对时，译码器无法工作。A、输入端B、输出端C、清零端D、使能端
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考题 计数器的两个输入端是（）。A、计数输入端和输出端B、复位端和计数输入端C、复位端和移位端D、计数输出端和复位端
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考题 单选题能实现从多个输入端中选出一路作为输出的电路称为（）。A 触发器B 计数器C 数据选择器D 译码器
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考题 单选题地址译码器的输入端应接到（）上。A 控制总线B 数据总线C 地址总线D 外部总线
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考题 填空题微电子交流计数自动闭塞中译码器的作用是（）交流计数器。
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