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程序访存更多在____中命中,可最大程度提高性能、降低功耗

A、本CPUcache

B、本CPU主存

C、本结点其他CPU主存

D、远端结点主存

参考答案

更多 “ 程序访存更多在____中命中,可最大程度提高性能、降低功耗 A、本CPUcacheB、本CPU主存C、本结点其他CPU主存D、远端结点主存 ” 相关考题
考题 下列关于虚拟存贮器的说法,比较正确的应当是()。 A.访主存命中率随页面大小增大而提高B.访主存命中率随主存容量增大而提高C.更换替换算法能提高命中率D.主存命中率低时，改用堆栈型替换算法，并增大主存容量，可提高命中率。
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考题 当CPU要访问Cache时,CPU通过总线送来的主存地址存于主存地址寄存器MAR中。() 此题为判断题(对，错)。
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考题 引入多道程序的目的在于()。A、充分利用CPU，减少CPU的等待时间B、提高实时响应速度，降低CPU及内存利用率C、有利于代码共享，减少主存辅存信息交换量D、充分利用主存储器
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考题 在CPU与主存之间加人Cache，能够提高CPU访间存储器的速率，一般情况下Cache的容量__命中率__，因此Cache容量_______。()A.越小，越高，与主存差异越大越好B.越大，越高，与主存越接近越好C.越小，越高，只要几K就可达90%以上D.越大，越高，只要几百K就可达90%以上
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考题 在CPU与主存之间设置，其目的是为了提高CPU对主存的访问效率。
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考题 主存和CPU之间增加高速缓存的目的是( )。A．解决CPU和主存之间的速度匹配问题B．扩大王存容量C．既扩大主存容量，又提高存取速度D．以上说法都不对
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考题 主存储器和CPU之间增加调整缓冲存储器的目的是（4）。A.扩大存储系统的容量B.解决CPU与主存的速度匹配问题C.扩大存储系统的容量和提高存储系统的速度D.全球程序的访存操作
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考题 在多级存储系统中，Cache处在CPU和主存之间，解决(55)问题。若Cache和主存的存取时间分别为T1和T2，Cache的命中率为H，则该计算机实际存取时间为(56)。当CPU向存储器执行读操作时，首先访问Cache，若命中，则从Cache中取出指令或数据，否则从主存中取出，送(57)：当CPU向存储器执行写操作时，为了使Cache的内容和主存的内容保持一致，若采用(58)法，则同时写入Cache和主存。由于Cache容量比主存容量小，因此当Cache满时，执行把主存信息向Cache写入，就要淘汰Cache中已有的信息，为了提高Cache的命中率，采用一种(59)替换算法。A．主存容量扩充B．主存和CPU速度匹配C．多个请求源访问主存D．BIOS存放
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考题 在多级存储体系中，“Cache-主存”结构的作用是解决(10)的问题。A．辅存与CPU速度不匹配B．主存与CPU速度不匹配C．主存容量不足D．主存与辅存速度不匹配
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考题 在存储管理中，采用覆盖与交换技术的目的是(16)。A．利用辅存解决主存容量不足的矛盾，提高主存利用率B．利用辅存提高CPU的利用率C．利用辅存节省主存空间D．将一个以上的作业放入主存，使之处于运行状态
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考题 在多级存储体系中，"Cache-主存"结构的作用是解决 ( ) 的问题。A.辅存与CPU速度不匹配 B.主存与CPU速度不匹配 C.主存容量不足 D.主存与辅存速度不匹配
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考题 下列关于虚拟存储器的说法，比较正确的是()。A.访主存命中率随存储容量增加而提高 B.更换替换算法能提高命中率 C.在主存命中率低时，改用堆栈型替换算法，并增大主存容量，可提高命中率 D.访主存命中率随页面大小增大而提高
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考题 CPU的工作周期为20ns，主存存取周期为10ns，此时DMA接口适合采用()方式与CPU共享主存。A.停止CPU访问主存 B.周期挪用 C.DMA与CPU交替访存 D.以上无正确选项
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考题 主存和CPU之间增加高速缓存的目的是____。A.解决CPU和主存之间的速度匹配问题 B.扩大主存容量 C.既扩大主存容量，又提高了存取速度 D.扩大辅存容量
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考题 下述关于主存与辅存比较的说法中，（）是正确的。A辅存与主存一样可与CPU直接交换数据B辅存的存取速度一般比主存的存取速度快C辅存与主存一样可用来存放程序和数据D辅存的容量一般比主存的容量大，但存取速度较慢
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考题 主存和CPU之间增加高速缓存的目的是（）。A、解决CPU和主存之间的速度匹配问题B、扩大存容量C、既扩大内存容量，又提高存取速度D、解决CPU与外存之间速度匹问题
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考题 在CPU与主存之间设置高速缓冲存储器（Cache），其目的是为了（）A、扩大主存的存储容量B、提高CPU对主存的访问效率C、既扩大主存容量又提高存取速度D、提高外存储器的速度
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考题 在存储管理中，采用覆盖与交换技术的目的是（）。A、减少程序占用的主存空间B、物理上扩充主存容量C、提高CPU效率D、代码在主存中共享
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考题 为解决CPU和主存的速度匹配问题，其实现可采用介于cPU和主存之间的（）A、光盘B、辅存C、cacheD、辅助软件
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考题 在多级存储体系中，“cache--主存”结构的作用是解决（）的问题。A、主存容量不足B、主存与辅存速度不匹配C、辅存与CPU速度不匹配D、主存与CPU速度不匹配
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考题 CPU可直接访问主存和辅存。
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考题 单选题存贮器可分为主存和辅存，下面4种说法那种是正确的（ ）A 主存和辅存都可直接与CPU交换数据。B 主存和辅存都采用半导体器件构成存贮元，故操作速度相同。C 主存直接和CPU交换信息，而辅存在需要时只与主存进行批量数据交换。D 主存容量小，而辅存容量大，故辅存区用来存放当前要执行程序。
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考题 多选题下述关于主存与辅存比较的说法中，（）是正确的。A辅存与主存一样可与CPU直接交换数据B辅存的存取速度一般比主存的存取速度快C辅存与主存一样可用来存放程序和数据D辅存的容量一般比主存的容量大，但存取速度较慢
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考题 单选题在存储管理中，采用覆盖与交换技术的目的是（）。A 减少程序占用的主存空间B 物理上扩充主存容量C 提高CPU效率D 代码在主存中共享
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考题 单选题在多级存储体系中，“cache—主存”结构的作用是解决（）的问题。A 主存容量不足B 主存与辅存速度不匹配C 辅存与CPU速度不匹配D 主存与CPU速度不匹配
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考题 单选题在CPU与主存之间设置高速缓冲存储器（Cache），其目的是为了（）A 扩大主存的存储容量B 提高CPU对主存的访问效率C 既扩大主存容量又提高存取速度D 提高外存储器的速度
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考题 单选题主存储器和CPU之间增加CaChe的目的是( )。A 解决CPU和主存之间的速度匹配问题B 扩大主存储器的容量C 扩大CPU中通用寄存器的数量D 既扩大主存容量也扩大CPU通用存器数量
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