考题
● 一个4位的二进制计数器，由 0000 状态开始，经过25 个时钟脉冲后，该计数 器的状态为 （24 ） 。（24 ）A. 1100 B. 1000 C. 1001 D. 1010
考题
一个五位的二进制加法计数器,由00000状态开始,问经过75个输入脉冲后,此计数器的状态为___。
考题
一个5位的二进制加法计数器,由00000状态开始,经过75个时钟脉冲后,此计数器的状态为()。
A、111B、1010C、1100D、1011
考题
根据异步二进制加法计数器的触发规律,每输入()个脉冲,第二位输出一个进位脉冲。
A、1B、2C、4D、8
考题
一个四位二进制加法计数器,初始状态为0000经过2015个时钟脉冲后,此计数器的状态为()
考题
一个4位的二进制计数器，由0000状态开始，经过25个时钟脉冲后，该计数器的状态为(24)。A．1100B．1000C．1001D．1010
考题
图所示逻辑电路，设触发器的初始状态均为0，当
时，该电路实现的逻辑功能是（ ）。
A．同步十进制加法计数器
B．同步八进制加法计数器
C．同步六进制加法计数器
D．同步三进制加法计数器
考题
设集成十进制加法计数器的初态为Q4Q3Q2Q1＝1001，则经过5个CP脉冲以后计数器的状态为（）A.0000
B.0100
C.0101
D.1001
考题
预置式十进制减法计数器，预置初始值为1001，当输入第六个计数脉冲后，其输出状态为（）A、0101B、0110C、0011D、1010
考题
同步计数器是将计数脉冲同时输入到各级触发器，当输入计数时钟脉冲触发时，各级触发器的状态同时发生转移。
考题
四位异步二进制减法计数器，先清零，2个脉冲后输出状态为（）A、1110B、0010C、1011D、0001
考题
三位异步二进制加法计数器的输出状态为110，2个脉冲后输出为（）A、000B、001C、101D、111
考题
三位二进制异步加法计数器，第4个CP脉冲后，计数器状态为（）A、000B、010C、100D、101
考题
一异步三位二进制加法计数器，当第8个CP脉冲过后，计数器状态变为（）。A、000B、010C、110D、101
考题
8421BCD码的二―十进制计数器状态是（）时，再输入一个计数脉冲，计数状态为0000，然后向高位发进位信号。
考题
根据异步二进制加法计数器的触发规律，每输入（）个脉冲，第二位输出一个进位脉冲。A、lB、2C、4D、8
考题
一个异步三位二进制异步加法计数器，当第4个CP脉冲过后，计数器的状态变为（）A、000B、010C、100D、101
考题
模13计数器的开始计数状态为0000，则它的最后计数状态是（）。
考题
每经十个CP脉冲状态循环一次的计数电路，知其有效状态中的最大数为1100，则正确的描述是（）。A、模10计数器B、计数器容量为10C、十进制计数器D、十二进制计数器
考题
每经十个CP脉冲状态循环一次的计数电路，知其有效状态中的最大数为1100，则欠妥的描述是（）。A、模10计数器B、计数容量为10C、十进制计数器D、十二进制计数器
考题
若4位同步二进制加法计数器当前的状态是0111，下一个输入时钟脉冲后，其内容为（）。A、0111B、0110C、1000D、0011
考题
一异步三位二进制加法计数器，当第8个CP脉冲后，计数器状态为（）。A、000B、010C、110D、101
考题
单选题每经十个CP脉冲状态循环一次的计数电路，知其有效状态中的最大数为1100，则欠妥的描述是（）。A
模10计数器B
计数容量为10C
十进制计数器D
十二进制计数器
考题
单选题预置式十进制减法计数器，预置初始值为1001，当输入第六个计数脉冲后，其输出状态为（）A
0101B
0110C
0011D
1010
考题
单选题三位异步二进制加法计数器的输出状态为110，2个脉冲后输出为（）A
000B
001C
101D
111
考题
多选题每经十个CP脉冲状态循环一次的计数电路，知其有效状态中的最大数为1100，则正确的描述是（）。A模10计数器B计数器容量为10C十进制计数器D十二进制计数器
考题
单选题四位异步二进制减法计数器，先清零，2个脉冲后输出状态为（）A
1110B
0010C
1011D
0001
考题
单选题若4位同步二进制加法计数器当前的状态是0111，下一个输入时钟脉冲后，其内容为（）。A
0111B
0110C
1000D
0011