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单选题
8255的引脚CS#，RD#，WR#信号电平分别为（）时，可完成“数据总线→8255数据寄存器”的操作。
A

1、1、0

B

0、1、0

C

0、0、1

D

1、0

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考题 8255a引脚信号wr=0、cs=0、a1=1、a0=1时,表示() A.CPU向控制口送控制字B.CPU向数据口写数据C.无效操作D.CPU读8255A控制口
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考题 当数据从8255a的端口c往数据总线上读出时,8255的几个控制信号cs、a1、a0、rd、wr分别是0、1、0、0、1。() 此题为判断题(对，错)。
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考题 8255A的数据总线缓冲器是一个双向三态8位缓冲器，是8255A与______的接口。A．CPU数据总线B．主存储器C．FO设备D．Cache
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考题 一台微机化仪器采用8255A；芯片作数据传送接口，并规定使用接口地址的最低两位作芯片内部寻址，已知芯片的A口地址为0F4H，则当CPU执行输出指令访问0F7H端口时，其操作为( )。A．数据从端口C送数据总线B．数据从数据总线送端口CC．控制字送控制字寄存器D．数据从数据总线送端口B
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考题 一台微机采用8255A芯片作数据传送接口，并规定使用接口地址的最低两位做芯片内部寻址，已知芯片A口地址为OF4H，则当CPU执行输出指令访问OF7H端口时，其操作为( )。A．数据从端口C送数据总线B．数据从数据总线送端口cC．控制字送控制字寄存器D．数据从数据总线送端口B
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考题 8255A的数据总线缓冲器是一个双向三态8位缓冲器，是8255A与( )的接口。A．CPU数据总线B．主存储器C．I/O设备D．CACHE
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考题 8255A引脚信号WR=0，CS=0，A1=1，A0=1时，表示（）。A、CPU向数据口写数据B、CPU读8255控制口C、CPU向控制口送控制字D、无效操作
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考题 当8255A引脚CS（）电平时，若RD、WR为（）时，表示数据总线为三态（高阻）。
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考题 8255具有（）个外设数据引脚，分成3个端口，引脚分别是（）、（）、（）
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考题 当数据从8255A的C端口读到CPU时，8255A的控制信号、、、A1、AO分别是什么电平？
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考题 8255的引脚CS#，RD#，WR#信号电平分别为（）时，可完成“数据总线→8255数据寄存器”的操作。A、1、1、0B、0、1、0C、0、0、1D、1、0
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考题 当数据从8255A的端口C往数据总线上读出时，8255A的几个控制信号CS、A1、A0、RD、WR分别是什么？
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考题 当8255A引脚RESET信号为高电平有效时，8255A内部所有寄存器内容被（），同时三个数据瑞口被自动设置为（）。
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考题 8255A工作于方式1输出时，在由外设输入的STD信号（）的控制下将端口A或（端口B）的数据锁存。A、上升沿B、下降沿C、高电平D、低电平
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考题 当8255A引脚RESET高电平有效时，3个端口自动设置为输出端口。
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考题 当8255A引脚CS为高电平时，若RD为（），WR为（）时则数据总线处于高阻状态。
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考题 8255的每个端口的数据寄存器的长度为8位。
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考题 向8255A的端口A写入数据时，下列引脚中信号为“0”的有（）A、CSB、RDC、WRD、A1E、A0
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考题 8086CPU往8255A端口C送数据时，则8255A芯片引脚A1A0为（）A、A1A0=00B、A1A0=01C、A1A0=10D、A1A0=11
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考题 单选题在8255接口电路中，若A组和B组工作于方式1，且为输出口，控制线由高电平跳变为低电平的时刻为（）。A CPU已送出一个数据到8255，输出缓冲器满B 8255已把输出缓冲器内容送出外设C 8255向CPU发中断请求时D CPU向8255输出缓冲器写新数据时
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考题 填空题当8255A引脚RESET信号为高电平有效时，8255A内部所有寄存器内容被（），同时三个数据端口被自动设置为（）端口。
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考题 判断题当8255A引脚RESET高电平有效时，3个端口自动设置为输出端口。A 对B 错
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考题 填空题8255具有（）个外设数据引脚，分成3个端口，引脚分别是（）、（）、（）
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考题 填空题当8255A引脚CS（）电平时，若RD、WR为（）时，表示数据总线为三态（高阻）。
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考题 填空题当8255A引脚CS为高电平时，若RD为（），WR为（）时则数据总线处于高阻状态。
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考题 判断题CPU送给8255A的控制字，以及输入数据和输出数据都通过8255A内的数据总线缓冲器传送。A 对B 错
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