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填空题
当CPU响应一次中断时，应将（）和（）和（）保存入栈。

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考题 CPU在中断响应过程中(),是为了能正确地实现中断返回。 A.识别中断源B.断点压栈C.获得中断服务程序入口地址D.清除中断允许标志IF
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考题 响应中断请求的条件是()。 A、外设提出中断;B、外设工作完成和系统允许时;C、外设工作完成和中断标记触发器为“1”时;D、CPU提出中断。
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考题 cpu响应中断请求和响应dma请求的本质区别是()。 A.控制简单B.速度慢C.响应中断时，CPU仍然仍控制总线，而响应DMA请求时，CPU要让出总线D.CPU响应中断请求和响应DMA请求的本质区别是()。
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考题 当多个设备同时产生中断请求时,影响cpu响应中断的顺序是()。 A.中断优先级和中断屏蔽码B.中断优先级C.中断屏蔽码D.中断允许标志
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考题 当8086CPU内标志寄存器中的IF=0时，意味着禁止CPU响应所有类型的中断。（）
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考题 CPU内部的中断允许标志位IF的作用是（）。A.禁止CPU响应可屏蔽中断 B.禁止中断源向CPU发中断请求 C.禁止CPU响应DMA操作 D.禁止CPU响应非屏蔽中断
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考题 当CPU响应一次中断时，应将（）和（）和（）保存入栈。
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考题 CPU响应中断请求和响应DMA请求的本质区别是（）。A、中断响应靠软件实现B、响应中断时CPU仍然能控制总线，而响应DMA请求时，CPU要让出总线C、速度慢D、控制简单
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考题 当标志IF=1时，CPU（）响应可屏蔽中断；当IF=0时，CPU（）响应可屏蔽中断。
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考题 CPU内部的中断允许标志位IF的作用是（）。A、禁止CPU响应可屏蔽中断B、禁止中断源向CPU发中断请求C、禁止CPU响应DMA操作D、禁止CPU响应非屏蔽中断
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考题 当CPU响应外设提出的中断申请后，应当如何？
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考题 CPU响应中断请求和响应DMA请求的本质区别是（）A、程序控制B、需要CPU干预C、响应中断时CPU仍控制总线而响应DMA时，让出总线D、速度快
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考题 8086在响应中断时，将CS、IP和标志寄存器的内容顺序入栈
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考题 对于非屏蔽中断申请，CPU响应条件为CPU允许中断和执行完现行指令。
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考题 在8086系统中，当CPU响应中断时，第几个INTA周期从数据总线读取中断号？
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考题 8086/8088CPU状态标志寄存器中IF=1时，表示（）。A、CPU可以响应非屏蔽中断B、CPU可以响应内部中断C、CPU可以响应可屏蔽中断D、CPU禁止响应可屏蔽中断
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考题 请描述CPU发生中断时入栈和出栈的过程，并分析堆栈段中数据的存储方式及栈指针变化之间的关系。
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考题 简述多重中断系统中CPU响应处理一次中断的步骤。
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考题 问答题简述多重中断系统中CPU响应处理一次中断的步骤。
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考题 单选题执行INTn指令或响应中断时，CPU入栈操作保护的次序是（）A FLAGS，CS，IPB CS，IP，FLAGSC FLAGS，IP，CSD IP，CS，FLAGS
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考题 单选题当多个外设同时产生中断时，CPU响应中断的顺序受（ ）的影响。A 中断优先级B 中断允许标志C 中断屏蔽码D 中断优先级和中断屏蔽码
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考题 问答题在8086系统中，当CPU响应中断时，第几个INTA周期从数据总线读取中断号？
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